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標題: verilog問題 [列印本頁]

作者: 886886 時間: 2016-9-21 17:38:17 標題: verilog問題

我有一個verilog的IP 旦是我想要將這個IP重複串接 (輸出變成下一個相同IP的輸入)請問該怎麼做?

作者: syuan08 時間: 2016-10-13 22:42:20

你先把input跟output列出來吧!!
然後要宣告module的名稱要不一樣!
不然他tool會看成是同一顆!

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