[問題求助] 如何用verilog寫鬧鐘? [複製連結]

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發表於 2016-12-4 23:51:38 |只看該作者 |倒序瀏覽

本帖最後由 assyoo 於 2016-12-4 23:53 編輯

請問誰曾用verilog寫出電子鬧鐘?
要在DE2上執行
就是有鬧鐘功能的時鐘
有時分秒
秒進位成分分進位成時不會有延遲

可以先調整時間設定為"目前時間"
再轉成鬧鐘模式調整鬧鐘時間
輸出用七段顯示器
等到"目前時間"跑到鬧鐘時間
鬧鐘就會響有聲音輸出

萬分感謝!

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